基于FPGA的容错异步串行收发器装置
- 申请号:CN201310041431.8
- 专利类型:发明专利
- 申请(专利权)人:中国科学院近代物理研究所
- 公开(公开)号:CN103176934A
- 公开(公开)日:2013.06.26
- 法律状态:实质审查的生效
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专利详情
| 专利名称 | 基于FPGA的容错异步串行收发器装置 | ||
| 申请号 | CN201310041431.8 | 专利类型 | 发明专利 |
| 公开(公告)号 | CN103176934A | 公开(授权)日 | 2013.06.26 |
| 申请(专利权)人 | 中国科学院近代物理研究所 | 发明(设计)人 | 苏弘;丁朋程;王晓辉;孔洁;千奕;佘乾顺;赵红赟;马晓利;牛晓阳 |
| 主分类号 | G06F13/38(2006.01)I | IPC主分类号 | G06F13/38(2006.01)I;G06F13/40(2006.01)I |
| 专利有效期 | 基于FPGA的容错异步串行收发器装置 至基于FPGA的容错异步串行收发器装置 | 法律状态 | 实质审查的生效 |
| 说明书摘要 | 本发明提出基于FPGA的容错异步串行收发器。本发明包括有数据发送器,数据接收器,扩展汉明码编码器,扩展汉明码解码器,多数表决器,少数表决器。对所有的模块分别做TMR处理。对于发送器,首先数据处理单元将要发送的数据送入扩展汉明码编码器,编码器将编码后的码字分别送入多数表决器,将多数表决器得到表决后的码字送入串行发送器中,串行发送器将并行数据转换成串行数据发送出去。对于接收器,将串行输入信号通过引脚输入到FPGA中,在FPGA中通过串行接收器实现接收数据的串并转换,串行接收器将串行数据转换成并行数据之后,送入解码器。 | ||
交易流程
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专利 -
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