半导体器件的制造方法
- 申请号:CN201010601699.9
- 专利类型:发明专利
- 申请(专利权)人:中国科学院微电子研究所
- 公开(公开)号:CN102543838A
- 公开(公开)日:2012.07.04
- 法律状态:实质审查的生效
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专利详情
专利名称 | 半导体器件的制造方法 | ||
申请号 | CN201010601699.9 | 专利类型 | 发明专利 |
公开(公告)号 | CN102543838A | 公开(授权)日 | 2012.07.04 |
申请(专利权)人 | 中国科学院微电子研究所 | 发明(设计)人 | 殷华湘;徐秋霞;许高博;孟令款;杨涛;陈大鹏 |
主分类号 | H01L21/768(2006.01)I | IPC主分类号 | H01L21/768(2006.01)I;H01L21/762(2006.01)I;H01L21/28(2006.01)I;H01L21/311(2006.01)I |
专利有效期 | 半导体器件的制造方法 至半导体器件的制造方法 | 法律状态 | 实质审查的生效 |
说明书摘要 | 本申请公开了一种半导体器件的制造方法,包括:在半导体衬底上形成第一栅叠层,第一栅叠层包括第一栅导体和位于第一栅导体和半导体衬底之间的第一栅电介质;在半导体衬底中形成源/漏区;在半导体衬底和第一栅叠层上形成包括至少一个牺牲层和位于所述至少一个牺牲层下方的绝缘层的多层结构;对多层结构进行第一次反应离子刻蚀,使得对所述至少一个牺牲层位于晶片中央位置的部分的刻蚀速率大于位于晶片边缘位置的部分的刻蚀速率,以获得凹形刻蚀剖面;对多层结构进行第二次反应离子刻蚀,以获得具有平整表面的绝缘层作为层间电介质层;相对于绝缘层选择性刻蚀第一栅叠层,其中去除第一栅导体而在绝缘层中形成开口;在开口内形成第二栅导体。 |
交易流程
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01
选取所需
专利 -
02
确认专利
可交易 - 03 签订合同
- 04 上报材料
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05
确认变更
成功 - 06 支付尾款
- 07 交付证书
过户资料
平台保障
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